the register clock path is multi-driven ?

macherie · 发表于 2022-7-29 16:52:02

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DC 综合的结果
报clock_gating时，有一条这样的log -> the register clock path is multi-driven ,该clk 时input clk ,请问这是什么问题导致的？

zero_ · 发表于 2024-1-31 13:35:39

我也遇到这个问题啦

逐梦帅年 · 发表于 2025-8-11 18:25:55

zero_ 发表于 2024-1-31 13:35
我也遇到这个问题啦

怎么解决的？哥们，我的也是
always @(posedge i_clk or negedge i_rstn)
begin
if(!i_rstn)
      rate_d3 <= 40'd0;
else if(vld_d3)
      rate_d3 <= rate;
else
      rate_d3 <= rate_d3;
end

逐梦帅年 · 发表于 2025-8-11 18:26:58

这个最后怎么修改的，兄弟

逐梦帅年 · 发表于 2025-8-11 18:29:40

最后怎么修改的？兄弟

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