cadence怎生成hspice网表

我叫夏满满 · 发表于 2022-3-26 15:30:37

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想用cadence搭好电路图，生成网表，再改一改用到hspice上

shanklin · 发表于 2022-3-26 16:17:33

Virtuoso内点击左上角Launch - ADEL - Setup - Simulator 中选hspiceD 然后在ADE中选择Simulation - Netlist - Create

渊默 · 发表于 2022-3-26 17:04:23

shanklin 发表于 2022-3-26 16:17
Virtuoso内点击左上角Launch - ADEL - Setup - Simulator 中选hspiceD 然后在ADE中选择Simulation - Netlis ...

生成的网表是指netlist文件吗，是不是在加进hspice之前把仿真什么的重新设置一下

shanklin · 发表于 2022-3-26 17:20:23

渊默发表于 2022-3-26 17:04
生成的网表是指netlist文件吗，是不是在加进hspice之前把仿真什么的重新设置一下
...

楼主问的应该就是生成网表文件吧

渊默 · 发表于 2022-3-26 20:00:29

shanklin 发表于 2022-3-26 17:20
楼主问的应该就是生成网表文件吧

我只是想问一下，生成的文件如果要加到hspice里面仿真是不是还要加仿真条件，我看那个网表只是元器件之间的互联

我叫夏满满 · 发表于 2022-3-28 13:59:01

shanklin 发表于 2022-3-26 16:17
Virtuoso内点击左上角Launch - ADEL - Setup - Simulator 中选hspiceD 然后在ADE中选择Simulation - Netlis ...

好的，我也试过，但是生成出来的文件里面什么都没有

shanklin · 发表于 2022-3-29 10:15:01

渊默发表于 2022-3-26 20:00
我只是想问一下，生成的文件如果要加到hspice里面仿真是不是还要加仿真条件，我看那个网表只是元器件之间 ...

对的需要PDK里的spice model

shanklin · 发表于 2022-3-29 10:17:32

我叫夏满满发表于 2022-3-28 13:59
好的，我也试过，但是生成出来的文件里面什么都没有

生成的时候CIW里面是否有warning？

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