allegro导入网表，差分信号报错

婕尽全力 · 发表于 2022-3-24 11:29:10

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allegro每次导入网表，PCB上的差分信号都会报错，有大佬知道是什么原因吗

婕尽全力 · 发表于 2022-3-24 11:30:05

自己顶一下哈~

王的秋天 · 发表于 2022-3-24 11:35:09

design rule设置问题吧

婕尽全力 · 发表于 2022-3-24 13:38:08

PCB Xnet都设置好了

婕尽全力 · 发表于 2022-12-19 16:31:12

原理图中对该部分的差分信号进行定义，而allegro走线时与其定义不一致导致报错

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