求助！LVS连线错误

804759740 · 发表于 2021-12-4 11:04:24

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如图所示，底层的LVS都是没有问题的，这是12路一样的输入端，只有第11路和第12路报错，错误是这两路连接相反了，好奇怪！其他路都没有报错。麻烦大神帮忙看看是什么原因 5LYNL%UQL20TPY~G2X@%VO2.png

804759740 · 发表于 2021-12-4 11:05:43

其中一路的输入端是这样的 ]U)Q9{HTITV5VGQ(TUTBZE8.png

FOREVER10 · 发表于 2021-12-4 19:44:39

你底层仔细看看，会不会有些 warning,还有就是 pin 有没有swap

804759740 · 发表于 2021-12-4 19:59:43

FOREVER10 发表于 2021-12-4 19:44
你底层仔细看看，会不会有些 warning,还有就是 pin 有没有swap

pin在top层跟底层的是不一样的金属层，应该没有swap底层和top层的LVS在ERC上都有这个warning，其他的没有看到有额外的问题、
B)8KRSIM0XCM5NRJAE0K(ZB.png

FOREVER10 · 发表于 2021-12-4 20:10:38

804759740 发表于 2021-12-4 19:59
pin在top层跟底层的是不一样的金属层，应该没有swap底层和top层的LVS在ERC上都有这个warning，其他的没有 ...

你看看底层cell lvs PASS 是不是又 text open connect的形式。
这样的话，你底层pass，但是上层可能一个pin是没接的。

还有就是你顶层看看，有没有什么 plus layer 盖到了什么，改变了管子的属性。

实在不行，你顶层不要连接起来，通过打text 连接，看看问题到底是出现在信号方向，还是底层cell方向。