电源抑制比

暂... · 发表于 2021-9-24 22:28:22

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请问我这样连接仿电源抑制比对吗？
另外，为啥这样链接做DC仿真，VN端的电压也是1.5V

老尤皮 · 发表于 2021-9-25 13:37:08

在电路模块里不要直接连gnd，把电源线和地线做成pin伸出来，在testbench里再连接到gnd和vdd
还要把10uA的电流源去掉
虚短虚断，VP是1.5，那么VN也是1.5
从你的电路图看，感觉你做电路的习惯还很不好，我建议从网上找一点cadence教程先学一学

暂... · 发表于 2021-11-24 19:55:26

老尤皮发表于 2021-9-25 13:37
在电路模块里不要直接连gnd，把电源线和地线做成pin伸出来，在testbench里再连接到gnd和vdd
还要把10uA的电 ...

请问做电路的习惯哪里不好了？希望您可以指正

阿彩 · 发表于 2021-11-24 20:23:27

暂... 发表于 2021-11-24 19:55
请问做电路的习惯哪里不好了？希望您可以指正

意思就是所有需要输入的都做成pin脚拉出来，用专门的testbench电路仿真

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