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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 3 BGR的理论基础
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楼主: jokerxb

[原创] 3 BGR的理论基础

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semico_ljj
发表于 2024-9-11 17:36:39 | 显示全部楼层
zan。。。
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Archetto1116
发表于 2025-3-19 13:54:38 | 显示全部楼层
感谢分享
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长江头TM
发表于 2025-4-12 00:40:00 | 显示全部楼层


wrss20080407 发表于 2021-8-9 09:21
楼主发的这个图，我也喜欢用。一个主要原因是电阻R2的存在，实际上大大减小了电阻的大小。但是仍然存在一个 ...


运放的offset占BGR失调的大头，要想降低，一种是加入时钟做斩波，一种是调大管子尺寸
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