关于loop gain

ssnhwlg · 发表于 2021-8-4 20:50:32

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本帖最后由 ssnhwlg 于 2021-8-5 11:34 编辑

请教下各位大佬，LDO电路后仿真PVT个别corner 下loop gain phase会翘起是什么原因呢，这样会有问题吗？
谢谢！

不好意思，上面那个是另外一个电路的。下面这个图才是。不过都是上翘的

。。。。。

虎大王 · 发表于 2021-8-4 21:10:34

没啥问题。不过你某些corner下DC GAIN才20几db，这个有点问题

spartan313 · 发表于 2021-8-4 21:58:27

2楼说的没错，你的dc gain 变化有些巨大，看看是不是有些管子进入线性区了； loop gain phase 在两三个GHz 翘起来应该是零点导致不过已经在带外了没啥关系

Jack~fa · 发表于 2021-8-4 22:12:09

从图看，不是个别上翘

ssnhwlg · 发表于 2021-8-5 11:35:02

Jack~fa 发表于 2021-8-4 22:12
从图看，不是个别上翘

的确是，贴错图了。

ssnhwlg · 发表于 2021-8-5 11:36:07

虎大王发表于 2021-8-4 21:10
没啥问题。不过你某些corner下DC GAIN才20几db，这个有点问题

好吧，这个问题要看下。。。

ssnhwlg · 发表于 2021-8-5 11:38:06

geo24 发表于 2021-8-4 21:58
2楼说的没错，你的dc gain 变化有些巨大，看看是不是有些管子进入线性区了； loop gain phase 在两三个GH ...

请教下一般PVT下变化多少算合理呀？谢谢！

spartan313 · 发表于 2021-8-5 13:18:27

一般SS corner + 高温（120°）和 FF corner + 低温（-40°）相差应该不会超过一倍，第二个图看着好一些了你的current source/iref/biasing ciruict 都已经是电路级别了吧

ssnhwlg · 发表于 2021-8-5 13:47:59

geo24 发表于 2021-8-5 13:18
一般SS corner + 高温（120°）和 FF corner + 低温（-40°）相差应该不会超过一倍，第二个图看着好一些 ...

是的，都是电路级别postsim了。

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