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[求助] cadence版图可以反向还原出电路图吗

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发表于 2021-7-24 18:27:40 | 显示全部楼层 |阅读模式

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如果可以的话,怎么操作呢?求教求教
发表于 2021-7-24 20:38:57 | 显示全部楼层
我也想知道,蹲
发表于 2021-7-25 07:30:03 | 显示全部楼层
run一下lvs,生成出来一个版图的网表,然后用生成的网表导成电路。。
发表于 2021-7-26 20:02:03 | 显示全部楼层
蹲一个答案
发表于 2021-7-27 08:42:39 | 显示全部楼层


fengrlove 发表于 2021-7-25 07:30
run一下lvs,生成出来一个版图的网表,然后用生成的网表导成电路。。


生成的电路图是管子级的吧,不可能是门级电路吧?
发表于 2021-7-27 09:25:59 | 显示全部楼层


haoren007 发表于 2021-7-27 08:42
生成的电路图是管子级的吧,不可能是门级电路吧?


hier run 不行吗?
发表于 2021-7-27 10:58:28 | 显示全部楼层


fengrlove 发表于 2021-7-25 07:30
run一下lvs,生成出来一个版图的网表,然后用生成的网表导成电路。。


请问是怎么run啊,没有cdl网表。
发表于 2021-7-27 11:03:15 | 显示全部楼层


小威_Liu 发表于 2021-7-27 10:58
请问是怎么run啊,没有cdl网表。


随便做一个电路就行呀~~虽然run不过,但是能生成layout的 netlist。。。
发表于 2021-7-27 11:20:43 | 显示全部楼层


fengrlove 发表于 2021-7-27 11:03
随便做一个电路就行呀~~虽然run不过,但是能生成layout的 netlist。。。


了解,多谢大佬
发表于 2021-8-11 09:21:45 | 显示全部楼层


小威_Liu 发表于 2021-7-27 11:20
了解,多谢大佬


你好,想问问layout生成的netlist怎么转换成电路?也是直接导进cadence吗?
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