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查看: 1748|回复: 5

[讨论] VCS不兼容复杂类型?? 不会吧...

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发表于 2021-2-28 21:57:04 | 显示全部楼层 |阅读模式

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本帖最后由 randolpha 于 2021-2-28 22:00 编辑

VCS不兼容复杂类型?? 不会吧...




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发表于 2021-3-1 09:35:58 | 显示全部楼层
加个',标准不同,早就不一样~
 楼主| 发表于 2021-3-1 10:11:02 | 显示全部楼层


A1985 发表于 2021-3-1 09:35
加个',标准不同,早就不一样~


求最新systemverilog标准文档...
发表于 2021-3-1 11:27:22 | 显示全部楼层


randolpha 发表于 2021-3-1 10:11
求最新systemverilog标准文档...


这个可以吗?

SystemVerilog3.1a语言参考手册.chm

6.39 MB, 下载次数: 0 , 下载积分: 资产 -3 信元, 下载支出 3 信元

 楼主| 发表于 2021-3-1 13:50:42 | 显示全部楼层
本帖最后由 randolpha 于 2021-3-1 13:56 编辑


3.1a应该没提到复杂类型如何赋值.不信,你瞧下.

SystemVerilog_3.1_final.pdf

2.26 MB, 下载次数: 2 , 下载积分: 资产 -2 信元, 下载支出 2 信元

systemverilog3.1a.pdf

4.05 MB, 下载次数: 2 , 下载积分: 资产 -3 信元, 下载支出 3 信元

发表于 2021-3-1 14:06:49 | 显示全部楼层


randolpha 发表于 2021-3-1 13:50
3.1a应该没提到复杂类型如何赋值.不信,你瞧下.


那就这个

IEEE Std 1800-2012 SystemVerilog.pdf

11.16 MB, 下载次数: 1 , 下载积分: 资产 -4 信元, 下载支出 4 信元

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