手把手教你如何在Innovus中分析clock tree质量

skew · 发表于 2021-3-15 13:29:48

mark一下，深入学习

Ashanner · 发表于 2021-3-15 23:47:24

赞一个

mhyyyyyy · 发表于 2021-7-1 16:42:48

mark

a2dcv · 发表于 2021-7-3 15:51:13

Thanks

supermanwc · 发表于 2021-8-30 13:13:12

mark

wisywyx · 发表于 2021-9-1 17:50:12

学习了学习了

fayang · 发表于 2021-9-8 10:05:50

niu !

lans0625 · 发表于 2021-9-8 22:24:56

thanks

lang之 · 发表于 2021-10-9 17:35:07

还有隐藏内容？？

skew · 发表于 2021-10-21 23:41:43

ime 发表于 2020-12-20 23:39
"上面的分析是报出实际上长tree后最长的clock path。然而，这些clock path往往并非physical上最长的clock p ...

意思是clock latency 最大的sink pin不一定是physical 距离clock source点最远的，有些sink pin 之前可能有function&scan mode 共用的MUX，不设ignore就会相互balance，导致tree被拖长，总之就是不同skew group之间进行balance导致tree 被拖长了，这种case要理清clock 结构，pre cts就要写好clock spec

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