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楼主: vectorli

[求助] SRAM部分区域无法写,可以读,请大神帮忙分析一下原因。

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 楼主| 发表于 2020-6-12 16:46:01 | 显示全部楼层


xiaojia102003 发表于 2020-6-12 14:20
样片ATPG过了吗?RAMbist功能过了吗?


这是一个老芯片该找,原方案较复杂,老板为了省成本,对部分功能进行了裁剪,同时取消了外挂ROM,把程序直接掩模到芯片上,很多测试接口也阉割掉了,因此没有ATPG,RAM是直接使用SMIC的工具compile出来的,因此也无RAMBIST。

 楼主| 发表于 2020-6-15 16:03:35 | 显示全部楼层
哪位老大再帮忙看看,是不是写的hold时间太短所致,CLK上升沿到CEN去使能之间只有1072ps:


这是lib库中CEN和CLK的时序约束:

    pin(CEN) {
        direction : input;
        capacitance : 0.024;
        timing() {
            related_pin    : "CLK" ;
            timing_type    : setup_rising ;
            rise_constraint(SRAMSH) {
            index_1 ("0.200, 0.400, 1.000, 2.000, 3.000");
            index_2 ("0.200, 0.400, 1.000, 2.000, 3.000");
            values ( \
            "0.305, 0.289, 0.278, 0.298, 0.336", \
            "0.311, 0.296, 0.284, 0.304, 0.342", \
            "0.302, 0.286, 0.275, 0.295, 0.333", \
            "0.256, 0.240, 0.229, 0.249, 0.287", \
            "0.197, 0.181, 0.169, 0.189, 0.228" \
            );
            }
            fall_constraint(SRAMSH) {
            index_1 ("0.200, 0.400, 1.000, 2.000, 3.000");
            index_2 ("0.200, 0.400, 1.000, 2.000, 3.000");
            values ( \
            "0.265, 0.257, 0.265, 0.315, 0.382", \
            "0.307, 0.299, 0.307, 0.357, 0.424", \
            "0.409, 0.400, 0.408, 0.458, 0.525", \
            "0.551, 0.542, 0.550, 0.599, 0.666", \
            "0.680, 0.671, 0.679, 0.728, 0.794" \
            );
        }    }
        timing() {
            related_pin    : "CLK" ;
            timing_type    : hold_rising ;
            rise_constraint(SRAMSH) {
            index_1 ("0.200, 0.400, 1.000, 2.000, 3.000");
            index_2 ("0.200, 0.400, 1.000, 2.000, 3.000");
            values ( \
            "-0.275, -0.257, -0.243, -0.258, -0.290", \
            "-0.281, -0.263, -0.249, -0.263, -0.295", \
            "-0.271, -0.254, -0.239, -0.254, -0.286", \
            "-0.225, -0.207, -0.193, -0.208, -0.239", \
            "-0.165, -0.147, -0.132, -0.147, -0.179" \
            );
               
            }
            fall_constraint(SRAMSH) {
            index_1 ("0.200, 0.400, 1.000, 2.000, 3.000");
            index_2 ("0.200, 0.400, 1.000, 2.000, 3.000");
            values ( \
            "-0.258, -0.250, -0.257, -0.306, -0.372", \
            "-0.299, -0.292, -0.298, -0.348, -0.413", \
            "-0.401, -0.393, -0.400, -0.449, -0.515", \
            "-0.542, -0.534, -0.542, -0.592, -0.658", \
            "-0.671, -0.662, -0.671, -0.721, -0.787" \
            );
    }    }    }

    pin(CLK) {
        direction : input;
        capacitance : 0.1278;
        clock    : true;
        min_pulse_width_low    : 0.5;
        min_pulse_width_high    : 0.5;
        min_period        : 1.709;
        max_transition        : 3.000;
        internal_power() {
        when : "CEN";
        power(SRAMP) {
          index_1 ("0.0 1.0");
              values ("0, 0")
          }   }
    internal_power() {
        when : "!CEN";
            rise_power(SRAMP) {
              index_1 ("0.0 1.0");
              values ("99.36833, 99.36833")
            }
            fall_power(SRAMP) {
              index_1 ("0.0 1.0");
              values ("0, 0")
          }   }
    }


写.jpg
发表于 2020-6-22 10:07:29 | 显示全部楼层


vectorli 发表于 2020-6-15 16:03
哪位老大再帮忙看看,是不是写的hold时间太短所致,CLK上升沿到CEN去使能之间只有1072ps:


如果要是hold不满足的话,应该所有的地址都有问题吧。另外fib的方案,是否可以进行clk取反后再连到ram的操作。
 楼主| 发表于 2020-7-4 09:08:46 | 显示全部楼层
地址总线某些位hold时间不够所致,FIB把CLK跳2个buf后,SRAM工作正常了。
发表于 2020-7-4 09:59:57 | 显示全部楼层
学习了
发表于 2020-7-14 16:13:24 | 显示全部楼层


vectorli 发表于 2020-6-12 11:19
另外,已经尝试把工作频率降为原来1/4,RAM写还是不正确。


是不是你的读写软件写的不对啊
发表于 2020-7-14 16:14:58 | 显示全部楼层


新嘴小王安子 发表于 2020-7-14 16:13
是不是你的读写软件写的不对啊


学习了
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