spice in导入网表问题

suochuan121 · 发表于 2020-5-18 16:52:03

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本帖最后由 suochuan121 于 2020-5-21 11:27 编辑

我用618 的 spiceIn导入网表的时候非常慢，导了一个inv就得2分钟，而且测试库中除了正常网表外还多了很多器件，pdk库中的差不多都有，这是为什么？input中设置为hspice就会倒入失败，cdl就没问题

小马哥爱逛 · 发表于 2020-5-19 09:10:13

导入的网表是自己写的，还是工厂提供的。有可能是流程上某个选项没有选对吧

suochuan121 · 发表于 2020-5-19 15:22:03

小马哥爱逛发表于 2020-5-19 09:10
导入的网表是自己写的，还是工厂提供的。有可能是流程上某个选项没有选对吧 ...

我是做实验自己导出的，用老版本的时候导入挺快的，也没乱七八糟的东西618导入设置可能出了问题，现在还没弄明白

suochuan121 · 发表于 2020-5-21 11:19:08

未解决

forevertoyou · 发表于 2020-5-21 15:21:02

IC6.1.6的导入的时候，电阻电容会滤掉是什么原因

forevertoyou · 发表于 2020-5-21 15:24:12

导进去的MOS管的尺寸也对应不上

andy2000a · 发表于 2020-5-21 15:40:02

你用老版本 hspice import 跟cdl import 有何不同? Import后 schematic会如何, 如 OPamp 的 netlist Import 后认出 opamp different input pair 吗?

forevertoyou · 发表于 2020-5-21 15:46:12

andy2000a 发表于 2020-5-21 15:40
你用老版本 hspice import 跟cdl import 有何不同? Import后 schematic会如何, 如 OPamp 的 netlist Impor ...

生成不了原理图

suochuan121 · 发表于 2020-5-22 09:09:18

感觉是应该自己看help

豇豆豆 · 发表于 2022-2-10 11:54:46

要写一个device map文件，确认spice网表里的device名和参数名和CDF里的对应上

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