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楼主: 老尤皮

[求助] 能不能利用NP两种bootstrap消除对采样共模的影响

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 楼主| 发表于 2021-12-20 17:11:55 | 显示全部楼层


some44 发表于 2021-12-19 22:38
楼主有没有bootstrap电路的一些入门资料?


1999年的那篇经典论文
发表于 2021-12-20 17:21:48 | 显示全部楼层
:victory:
发表于 2021-12-21 14:03:50 | 显示全部楼层


老尤皮 发表于 2021-12-20 17:11
1999年的那篇经典论文


楼主你有吗?有的话能不能发一下?我现在电脑有点问题,只能用手机看,手机干啥都不方便
 楼主| 发表于 2021-12-21 18:50:51 | 显示全部楼层


some44 发表于 2021-12-21 14:03
楼主你有吗?有的话能不能发一下?我现在电脑有点问题,只能用手机看,手机干啥都不方便
...


开关论文.pdf (375.47 KB, 下载次数: 130 )


发表于 2021-12-22 10:01:57 | 显示全部楼层
感谢楼主
发表于 2022-8-3 22:45:53 | 显示全部楼层
楼主有没有试过top plate Vcm switch open的时间比input switch open的时间提前一些呢?先断上级板?或者你故意加一些对地的cap?
 楼主| 发表于 2022-8-5 23:45:56 | 显示全部楼层


hzx85337856 发表于 2022-8-3 22:45
楼主有没有试过top plate Vcm switch open的时间比input switch open的时间提前一些呢?先断上级板?或者你 ...


正常的底板采样都是顶板先断。加电容会影响噪声。
发表于 2023-2-6 16:09:29 | 显示全部楼层

                               
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看看这个性能怎么样呢,如何降低三次谐波?用two phase 的bootstrap好像不管用啊
发表于 2024-9-25 16:15:21 | 显示全部楼层


老尤皮 发表于 2021-12-20 17:11
1999年的那篇经典论文


A 1.5V 10bit 14.3Ms/s CMOS pipeline analog-to-digital converter

请问是这篇吗?
 楼主| 发表于 2024-9-26 10:01:05 | 显示全部楼层


cyc1818 发表于 2024-9-25 16:15
A 1.5V 10bit 14.3Ms/s CMOS pipeline analog-to-digital converter

请问是这篇吗?


是的
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