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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › 基于Spyglass的同步设计分析与静态验证
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楼主: edacw

[资料] 基于Spyglass的同步设计分析与静态验证

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liyu266
发表于 2020-9-1 17:10:27 | 显示全部楼层
谢谢，正需要
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发表于 2020-9-9 19:38:24 | 显示全部楼层
谢谢分享
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发表于 2020-9-10 11:42:40 来自手机 | 显示全部楼层
谢谢！西电还是很厉害
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发表于 2020-10-15 22:37:11 | 显示全部楼层
感谢分享
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发表于 2020-10-19 16:49:47 | 显示全部楼层
thanks
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发表于 2020-10-19 21:43:32 | 显示全部楼层
最近刚好在看spyglass, 收下了！多谢
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发表于 2020-12-29 14:51:09 | 显示全部楼层
非常好的文档！
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发表于 2021-7-17 09:48:36 | 显示全部楼层
学习学习
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发表于 2021-7-19 01:37:32 | 显示全部楼层
感谢分享！, 謝谢分享！
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发表于 2021-11-24 09:41:19 | 显示全部楼层
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