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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › ８＊８的乘法器verilog源代码,,
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楼主: xuemingyang

８＊８的乘法器verilog源代码,,

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sciencew
发表于 2009-3-27 00:35:10 | 显示全部楼层
eetop
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发表于 2009-3-28 09:09:21 | 显示全部楼层
hehe  xiexiele
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发表于 2009-3-28 12:00:28 | 显示全部楼层
应该很不错的谢谢啊
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发表于 2009-4-12 17:37:49 | 显示全部楼层

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好东西！！！
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发表于 2009-4-12 17:52:22 | 显示全部楼层
看一看
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iicing
发表于 2009-4-12 21:55:14 | 显示全部楼层
下载看看
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ltycool
发表于 2009-4-26 20:42:41 | 显示全部楼层


   
原帖由 xuemingyang 于 2007-11-26 10:32 发表

                               
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８＊８的乘法器verilog源代码,,

tai bang le ! chi hic lou zhu
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ltycool
发表于 2009-4-26 20:46:58 | 显示全部楼层


   
原帖由 xuemingyang 于 2007-11-26 10:32 发表

                               
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８＊８的乘法器verilog源代码,,

98这个东西我找了好久呢！
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发表于 2009-4-27 14:05:02 | 显示全部楼层
seesee ba~~
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lily1944
发表于 2009-5-3 11:22:40 | 显示全部楼层
谢
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