验证LVS后电阻值版图与电路不一样

hefeibo · 发表于 2019-11-5 11:04:11

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最近跑LVS 遇到如下几个问题，一直未能解决！检查所有连线都没有问题，电阻之间的间距也没有关系，器件也没有调错。请问该问题是怎么产生的，需如何解决？
求大佬赐教。谢谢！

zhangtaotao1212 · 发表于 2019-11-5 11:31:49

电路里面那个pin vh!你是怎样处理的？一般有！需要注意

hefeibo · 发表于 2019-11-5 13:36:55

zhangtaotao1212 发表于 2019-11-5 11:31
电路里面那个pin vh!你是怎样处理的？一般有！需要注意

电路说PDK的问题

Miya.huang · 发表于 2019-11-6 10:20:21

zhangtaotao1212 发表于 2019-11-5 11:31
电路里面那个pin vh!你是怎样处理的？一般有！需要注意

是Pin WH 沒接上或沒認到

ligenhang · 发表于 2019-11-6 11:34:26

wh!是不是电阻的阱电位,让电路把这个电位具体连到哪里填到器件里面去.

chinarml · 发表于 2019-11-7 07:43:17

1,spice里面单位弄错了，比如第一个电阻的阻值，LVS的结果是2.*e+6 , 而spice里面是2.*e+3
这里需要你去检查一下你的spice里面单位是怎么定义的。
2，spice中电阻的阻值精确度和版图lvs跑出来的不一样，LVS:2.01637 spice：2.016小数点后差了两位。这种情况一般需要修改spice，将spice里的阻值改为和lvs的一样。