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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 集成电路静态时序分析与建模
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楼主: 小明d

[资料] 集成电路静态时序分析与建模

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Nouins
发表于 2023-1-31 13:58:30 | 显示全部楼层
很好的资源，感谢分享
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dannymu
发表于 2023-2-1 17:26:07 | 显示全部楼层
谢谢
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bsweda
发表于 2023-2-28 09:31:51 | 显示全部楼层
下来看看
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cindy_yao
发表于 2023-3-28 00:04:00 | 显示全部楼层
感谢分享
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zyffpga
发表于 2023-3-28 11:59:35 | 显示全部楼层
好资料多谢分享
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hgbest
发表于 2023-3-28 22:34:12 | 显示全部楼层
非常不错
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Candydarte
发表于 2023-3-29 18:37:52 | 显示全部楼层
kkkkk
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akiyamamio
发表于 2023-3-31 20:59:47 | 显示全部楼层
感谢分享
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fhshbian
发表于 2023-4-1 15:47:04 | 显示全部楼层
感谢分享
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dannymu
发表于 2023-4-3 16:30:25 | 显示全部楼层
谢谢
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