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楼主: carneval

Verilog-A资料(安捷论的)模拟系统行为级仿真必备

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发表于 2008-2-27 22:27:35 | 显示全部楼层
Verilog-AMS HDL introduces a new data type, called net_discipline, for representing analog nets and declaring disciplines of all nets and regs. The
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发表于 2008-2-28 17:41:08 | 显示全部楼层
下了看看怎样吧
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发表于 2008-2-29 12:51:11 | 显示全部楼层
thanks
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发表于 2008-3-2 23:06:55 | 显示全部楼层
多谢多谢啊
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发表于 2008-3-3 09:03:10 | 显示全部楼层
看来又是英文的读起来很费劲
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 楼主| 发表于 2008-3-11 11:07:53 | 显示全部楼层
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发表于 2008-3-11 11:10:07 | 显示全部楼层
:victory: :victory:
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发表于 2008-3-16 16:35:02 | 显示全部楼层
so kind of you
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发表于 2008-3-16 17:13:09 | 显示全部楼层
顶!顶!顶!
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发表于 2008-3-16 18:24:03 | 显示全部楼层
thanks
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