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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › 关于Calibre DRC报错
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查看: 2849|回复: 6

[求助] 关于Calibre DRC报错

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l153603666
发表于 2019-3-26 22:43:46 | 显示全部楼层 |阅读模式

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新人求助，我在画反相器版图跑DRC时出现如下报错：
onvention_Lat_3a1: Maximum space from any point within Source/Drain region to the nearest pick up AA region in side the same well for I/O and internal circuits

已检查过电路连接OK，LVS OK。

请大神帮忙指点一下



INV.png
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lianaissmec
发表于 2019-3-27 08:58:41 | 显示全部楼层
检查闩锁效应的规则，满足这个规则才能避免发生闩锁
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lechunlingcola
发表于 2019-3-27 09:10:26 | 显示全部楼层
pmos  nmos都加上Guardring就好
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l153603666
 楼主| 发表于 2019-3-27 11:00:53 | 显示全部楼层


lechunlingcola 发表于 2019-3-27 09:10
pmos  nmos都加上Guardring就好


好的，我试一试
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l153603666
 楼主| 发表于 2019-3-27 11:01:51 | 显示全部楼层


lianaissmec 发表于 2019-3-27 08:58
检查闩锁效应的规则，满足这个规则才能避免发生闩锁


不好意思，我是初学者，不太懂怎么检查，可以大概说一下嘛？
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shfeiwang
发表于 2019-3-29 15:01:05 | 显示全部楼层
latchup问题，可以这么理解，mos有源区的任意一个点在方圆多少um内必须要见到一个对应的tap。
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shfeiwang
发表于 2019-3-29 15:01:43 | 显示全部楼层


l153603666 发表于 2019-3-27 11:01
不好意思，我是初学者，不太懂怎么检查，可以大概说一下嘛？


工具都已经给你检查出来了，你只要加一些tap就好
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