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查看: 3715|回复: 7

[解决] emmc 成熟设计

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发表于 2018-12-23 22:00:40 | 显示全部楼层 |阅读模式

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一:基于EMMC IP

1:采用纯Verilog语言设计,几乎任何FPGA都可以轻松移植。

2:目前主要用于Xilinx 7系列FPGA,支持模式有High SpeedSDRHigh Speed
DDRHS200模式。

3FPGA资源消耗极小


联系人 微信号:emmc_sata

  
  
  系统时钟
  
  写速度(每次256扇区)    读速度(每次256扇区)  
  High Speed SDR    50MHZ    43.4MB/S    46.9MB/S  
  High Speed
DDR  
  50MHZ    67.1MB/S    88.6MB/S  
  HS200     120MHZ    81.7MB/S    112.7MB/S  
  HS200     200MHZ    132.7MB/S    186.7MB/S  

发表于 2019-2-27 22:25:37 | 显示全部楼层
thanks for sharing
发表于 2021-7-1 18:17:25 | 显示全部楼层
谢谢楼主,作为参考看一下
发表于 2021-8-2 17:42:26 | 显示全部楼层
谢谢楼主
发表于 2021-12-27 00:25:33 | 显示全部楼层
IP在哪儿呢?
发表于 2021-12-27 00:26:49 | 显示全部楼层
哪儿能下载到呢?
发表于 2021-12-28 19:06:21 | 显示全部楼层
哪里下载
发表于 2021-12-28 19:30:55 | 显示全部楼层
thank you
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