全差分折叠Cascode放大电路MOS管参数

eryuerugu · 发表于 2018-11-22 17:44:57

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各位大神，求助！
小弟设计某运放电路，110nm工艺，基本如上图，3.3V供电，将VB0和VB1接一起后，VIN共模为1.6V，DC仿真后，输入管对管进入亚阈值区，这种问题怎么处理？VB0和VB1通过偏置电路单独产生还是共用即可？运放所有L设置为550nm，不知是否合适，电路主要考虑高增益，对速度要求不高。在此先谢谢啦！

SHAOJIHUA1234@1 · 发表于 2019-12-17 15:52:21

学习中

[求助] 全差分折叠Cascode放大电路MOS管参数

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