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查看: 3566|回复: 16

数字系统设计-verilog实现

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fjlihh
发表于 2007-10-17 22:24:52 | 显示全部楼层 |阅读模式

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数字系统设计-verilog实现.part1.rar

3.81 MB, 下载次数: 66 , 下载积分: 资产 -2 信元, 下载支出 2 信元

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fjlihh
 楼主| 发表于 2007-10-17 22:30:51 | 显示全部楼层
part 2

数字系统设计-verilog实现.part2.rar

1.64 MB, 下载次数: 57 , 下载积分: 资产 -2 信元, 下载支出 2 信元
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yongjiefan
发表于 2007-10-19 17:10:29 | 显示全部楼层
下来看看看看~~~~~~
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yongjiefan
发表于 2007-10-19 17:20:37 | 显示全部楼层
感觉还比不上夏宇闻的！~~~~~~~~
EETOP创芯人才网职位发布入口
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zy_sh_npk
发表于 2007-10-25 21:15:11 | 显示全部楼层
看看，谢谢了！
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zy_sh_npk
发表于 2007-10-25 21:18:12 | 显示全部楼层
怎么下来的文件大小是0字节呢？
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zy_sh_npk
发表于 2007-10-25 21:33:20 | 显示全部楼层
还不错的，顶！
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hqli126
发表于 2007-10-26 09:39:41 | 显示全部楼层
好 ,内容不错 .
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locomotive
发表于 2007-12-29 22:33:11 | 显示全部楼层
下来看看好东东
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locomotive
发表于 2007-12-29 22:34:47 | 显示全部楼层
下不来呢,为啥
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