请问VHDL转Verilog的软件有吗？

jinal · 发表于 2018-9-28 09:39:56

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C&S&M这三家有没有类似的软件？

jimwang94306 · 发表于 2018-9-29 10:53:01

沒有
三家都吃兩種，混合輸入，不需轉檔。
再說VHDL有兩個語句，Verilog不能表達，除非你VHDL沒用那兩語句，否則翻不出來。機會是你手頭的VHDL一定用了。我也知道你去了OPENCORE網站。
網路有一些FREE的翻譯軟體，翻的不像話。有也等於沒有。
你直接學三家混合輸入，還能保證合成SoC成功。

jinal · 发表于 2018-9-29 12:25:15

谢谢楼上！

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