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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › AXI Master/Slave Robustverilog已破解

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楼主: 夜风恋明月

[原创] AXI Master/Slave Robustverilog已破解

发表于 2020-5-3 12:59:58 | 显示全部楼层

1.5也出来了吧

畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！

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发表于 2020-5-23 18:35:35 | 显示全部楼层

Thank you very much !

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发表于 2020-5-25 23:42:31 | 显示全部楼层

谢谢分享

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发表于 2020-9-15 15:07:15 | 显示全部楼层

谢谢分享

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发表于 2020-9-16 15:55:49 | 显示全部楼层

请问生成axi interconnect的时候为什么会报VERIF错误

畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！

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发表于 2020-9-16 17:20:23 | 显示全部楼层

Thanks for sharing!

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发表于 2020-11-9 08:41:24 | 显示全部楼层

非常感谢楼主分享，单master做得很好。但如果选择多master就会报错了。

畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！

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发表于 2020-11-26 15:32:59 | 显示全部楼层

what is it, CC

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发表于 2021-9-15 16:55:33 | 显示全部楼层

i will check it out

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发表于 2021-9-15 21:13:13 | 显示全部楼层

感谢分享。

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