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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › 资源共享 › EDA资源使用讨论 › Cadence PLL Verification Workshop
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楼主: edafolks

Cadence PLL Verification Workshop

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昵称未占用
发表于 2024-3-22 19:32:32 | 显示全部楼层
thank u!
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把你砍成渣
发表于 2024-4-29 11:04:45 | 显示全部楼层
hi du, can you help to share something about ADC's design from the cadence workshop
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shengdaozhe
发表于 2024-5-4 01:06:42 | 显示全部楼层
thanks
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gliaoyuli
发表于 2024-5-11 22:22:44 | 显示全部楼层
thanks for sharing~~~~
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warewise6836
发表于 2024-5-11 23:07:47 | 显示全部楼层
謝謝。感恩。
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TIPSYYYY
发表于 2024-5-24 10:42:10 | 显示全部楼层
谢谢
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ICzccc
发表于 2024-6-6 18:23:38 | 显示全部楼层
谢谢分享，学习一下
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TIPSYYYY
发表于 2024-6-21 10:26:15 | 显示全部楼层
谢谢
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艾斯克莱因
发表于 2024-9-28 23:15:09 | 显示全部楼层
感谢分享
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wushangkeji
发表于 2024-11-1 15:51:12 | 显示全部楼层


m8510a 发表于 2024-1-26 11:42
路径在这里，可以调用一下，就可以使用了。


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