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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › 硬件设计论坛 › 电路设计论坛(数字/模拟) › 电路设计资料 › 一个不错的testbench教程(包含vhdl和verilog)
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楼主: lkj2003

一个不错的testbench教程(包含vhdl和verilog)

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michaelning
发表于 2010-11-23 14:48:00 | 显示全部楼层
回复 1# lkj2003


    下了打不开
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zhli11
发表于 2010-11-29 08:55:00 | 显示全部楼层
xiexiele
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zhli11
发表于 2010-11-29 09:04:33 | 显示全部楼层
看看看看
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zhli11
发表于 2010-11-29 09:05:37 | 显示全部楼层
看看看看
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stepan
发表于 2011-1-27 11:29:35 | 显示全部楼层
dddddddd
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finelei2002
发表于 2011-2-6 10:20:11 | 显示全部楼层
不能打开，请楼主修复
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zllei
发表于 2011-2-19 09:52:59 | 显示全部楼层
xiexie  x
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vvzvv
发表于 2011-2-19 22:20:52 | 显示全部楼层
回复 1# lkj2003


   好东西，很好的东西
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123__456
发表于 2011-4-11 06:49:36 | 显示全部楼层
文件已经损坏了呀，这么多人都表示文件打开有问题，楼主却一点反应也没有，不是很负责任啊！！
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hcm608
发表于 2011-5-11 14:03:21 | 显示全部楼层
~~~~~~~~~~~~~~~~
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