面向微电子专业的免费培训--—工艺规则DRC/LVS/RCX的Rule开发及验证

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上海的培训今天结束，感谢参加培训的网友们的讨论和交流。
    北京的培训时间初步计划在5月5日，5月6日两天，具体时间和地点还需再确认。

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2018年4月21日-4月22日，在上海举行了一次面向工程师的免费“DRC/LVS/RCX Runset"培训，该培训借鉴了互联网的互动模式，在eetop和水木清华上发贴，通过自下向上的方式吸引来自不同公司的工程师参加该培训，受到了广大工程师的欢迎。
    培训讲师具有10年以上的Runset核心算法开发经验和9年以上的Runset应用开发经验，在两天地时间内，深入浅出地把DRC/LVS/RCX的原理和应用做了系统性和专业性的介绍，并且与工程师进行了深入交流和讨论。
    一位参与培训的工程师反馈：之前我对DRC/LVS/RCX都有过全面地使用，也修改过DRC/LVS/RCX Runset，但是没有一个系统性和原理性的深入理解，通过培训，我掌握了这些领域的基本原理和应用背景，对我今后工作大有益处。
    另一位工程师反馈：之前我也参加过类似的Runset培训，但是该类培训仅仅是从语法上讲DRC/LVS/RCX Runset，没有从Design rule与Runset的联系本质上讲述，而本次培训侧重于如何理解Design Rule的精确含义，如何把Design Rule转换成Runset这个角度进行了详细讲述。这个角度的讲述是国内第一次听到，这是一个需求导向性的培训，而不是传统的过程导向型的培训，实用性远远大于其它类型的培训。
    还有一位工程师反馈：我之前修改过Foundry提供的DRC Runset，也检查发现过Foundry提供的Runset的错误，但是不知道如何系统地对Runset进行验证，本次培训不仅讲述了Runset如何开发，而且重点讲述了Runset如何进行准确全面地验证，掌握了该方法对我今后验证Runset的准确性很有帮助。

     总结工程师的反馈，本次培训的内容核心为3点：

1.   如何准确地理解Design rule的含义
2.   如何把Design Rule转换为DRC/LVS/RCX Code
3.   如何验证DRC/LVS/RCX Code与Design Rule的一致性

    传统的培训仅仅讲述第2点，并且是仅仅讲述第2点的Code语法描述，不讲述Design Rule到Code的转换原理和思路。而本次培训把全流程进行了充分的讲解和分析，是对传统培训的一个根本性的变化。

     培训结束后，根据部分公司的建议，培训讲师又花3-4天时间到部分上海本地公司和长三角的公司进行单独讨论和培训，有针对性地解决公司遇到的实际问题。把培训和解决公司实际问题有效结合，实现了线下和线上的融合，对探索国内EDA产业如何学习互联网的O2O模式做了有益尝试。

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已经报名北京培训的请注意， 5月2日将发送具体培训地点通知，请注意查收email和短信。

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    根据上海培训的反馈意见，北京培训预计新增ESD/Latch up的检查培训，内容如下：  
     
        ESD/Latch up检查是版图设计人员经常遇到的难点问题，虽然Calibre工具提供了PERC的工具，但是由于其配置太复杂，一般的Fabless工程师很难理解如何使用。另外一种策略是：直接用Calibre DRC的工具来书写ESD/Latch up的规则文件，通过复杂DRC命令的组合来实现ESD/Latch up的检查。但是，这种思路会遇到以下几个难点：  
     
     
a.   阻挡命令，在ESD/Latch up的规则中，有多个命令需要检查在两个layer之间是否有第三个layer阻挡，Calibre的DRC规则中没有类似检查，不支持该命令，因此该类错误无法检查。  
     
b.    Guard Ring的长宽比计算，该命令检查在Gurard Ring中的Metal的w/l是否满足要求，其中l是Guard Ring的长度，Calibre DRC不支持动态变化约束的命令，无法实现。  
     
c.    斜线阻挡命令，除了正对的阻挡命令外，还需要支持斜向阻挡，Calibre DRC规则无法实现。  
     
d.    电阻计算命令，在ESD/Latch up的命令中，有多个命令需要检查电阻值的大小，Calibre的DRC命令中不支持电阻计算。  
     
e.     大尺寸问题，ESD/Latch up的规则一般都是100um, 200um的大尺寸，如果简单地用DRC命令来实现，运行效率很低。  
     
     
       本次培训重点讲述如何解决上述难点问题：  
     
1.   挡住规则的检查  
     
     
功能：　寻找LayerA与LayerB的最近的图形之间的垂直投影区域，如果LayerA与LayerB之间有多个图形，只寻找最近的图形。输出他们之间的区域。  
     
     
     
     
2.   对角线阻挡的检查  
     
     
        为了检查斜线阻挡问题，针对Guard Ring的阻挡判断，增加了两条命令的组合来实现：  
        如上图所示，LayerA 有2个红色的图形，LayerB有一个绿色图形，则运行该条命令结束后，工具会输出连接A与B的黑色线段。注意，输出结果是线段，而不是图形，这些线段之间可以有交叉，但是他们不会相互干扰，而是各自独立。  
     
        该命令在形成黑色的线段后，并不是把这些线段作为结果直接输出，而是要针对每条线段判断是否与上一条命令的输出结果图形有相交，如果相交就不输出，如果没有相交，就把结果输出。  
     
     
     
3.  Guard Ring的宽度与长度比值计算  
     
     
       WiringMetal的rule主要检查在GuardRing的内部金属走线的最小宽度与GuardRing的长度的比值是否小于1/1000，如果GuardRing有bridge，并且bridge的个数为n，则检查比值是否小于1/1000/(n+1)。  
     
      
　　  
       ( 上述是几个典型的ESD/Latch up Rule）  

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上海和北京的DRC/LVS/RCX/ESD_latchup Runset培训结束了，正在准备进行深圳的培训，有深圳附近的朋友可以参加。  
  
      深圳培训主要内容：
  
a.  DRC Runset开发与验证
b.  ESD_Latchup的开发
c.  LVS_Runset的开发与验证
d.  RCX_Runset的开发与验证
e.  Pcell QA

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    深圳的培训时间已经确定： 5月19日/20日两个整天。 有感兴趣的请报名，参加本次培训的工程师可获得免费使用一定期限的Runset QA工具的机会，帮你查出Runset潜在的风险和问题。

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根据前几次培训的反馈，深圳的培训增加了如何快速阅读理解DRC/LVS Code的方法，通过图形化的界面显示layer的依赖关系来分析Code，通过自动化debug每个中间layer的输出结果来分析每条语句的具体含义。

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      2018年5月19日，5月20日，公司在深圳举行了DRC Runset/LVS Runset/RCX Runset/ESD_Latchup Runset和Pcell QA的培训，与在上海/北京的培训内容相比，本次培训增加了如何通过xcal工具快速阅读和理解DRC code的内容，培训内容随着听众的反馈和建议一次比一次丰富，受到了工程师的好评。

    一位参加深圳培训的工程师写到：“感谢2位博士讲师给我们带来精彩的drc/lvs/esd/rcx/pcell等方面的介绍。你们辛苦了! 也期待两位博士再次来深圳介绍新的产品。我们深知自主研发eda是一条及其艰难的路。但庆幸的是 ，有这样的国内企业一直在这个领域坚持着。真心希望国内能够多一些这样的企业，去从最基础的eda软件层面来帮助我们国内企业提高设计质量，提升产品竞争力。目前市面上的传统商业巨头Synopsys，Cadence，Mentor能够普遍使用，其实也是依靠广大用户的一直使用和反馈得以发展到今天这个局面的。 所以真心希望大家能给这样的企业多一些支持，多使用以及多多提一些建议。”

    另一位工程师写道： “培训很精彩，受益良多，下次还捧场。中国芯发展太需要这样的企业了。”

    一位来自外地的高校教师周五下午刚刚得知培训消息，周五连夜乘飞机到达深圳，对培训中提到技术和产品提出了很多中肯的建议，并希望积极开展合作，探索国内IC产业的产学研合作新模式。

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回复 8# houjs


  你好，我想问一下关于LVS验证的时候出现的未定义的层名参数问题应该怎么解决，看了规则文件，确实没有关于那个参数名的定义，想知道这种是表示的什么意思？可以帮忙解答一下吗？谢谢了这个是我添加LVS工艺文件后，运行LVS报的错误


这个是那个LVS规则文件

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回复 19# ld1253590798


      需要在LVS code中添加一句：

      LAYER    m1_nodev   xxxxx

       其中xxxx是它的layer number .