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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 请教建库时序问题

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[求助] 请教建库时序问题

发表于 2017-6-13 17:41:58 | 显示全部楼层 |阅读模式

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想请教各位大神，对于固定功能模块(比如一个复杂的加法器，或者一个带纠错端口的非普通D触发器)，建库之后能够提出来DC综合需要的时序信息吗？还是在布局布线之后才能够得到时序信息

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