PT SI hold timing

偶尔很卑鄙 · 发表于 2016-12-8 17:16:15

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直接上主题：PT分析结果hold已经clear。但是当我将sdc某个时钟频率降低后再跑PT时，又出现了
hold violation。两次我使用的spef相同，只修改过sdc时钟频率。我将有violation的path两次对比下，原因是-crosstalk_delta差别造成的。

我的想法是改变了时钟频率影响crosstalk_delta值的计算？具体的我不太清楚了，求大牛指点，如果真是这样的话，因为设计中这个时钟要跑不同的频率，我需要保证要跑的频率hold都干净吗？提前谢谢了！！

[求助] PT SI hold timing

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