设为首页收藏本站
在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名：电子顶级开发网)

手机号码，快捷登录

手机号码，快捷登录

找回密码

  登录   注册  

快捷导航
创芯云服务  : 创芯大讲堂  | 创芯人才网 | 数字IC职业培训  EETOP诚邀线上IC培训讲师!
搜帖子
EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证讨论 › DDR2 DDR3 constraint note
返回列表 发新帖
查看: 2139|回复: 0

DDR2 DDR3 constraint note

[复制链接]
索手锋芒
发表于 2016-7-14 15:02:27 | 显示全部楼层 |阅读模式

马上注册，结交更多好友，享用更多功能，让你轻松玩转社区。

您需要 登录 才可以下载或查看，没有账号？注册

x
说明：



  • 有一些constraint根项目相关，且不包含initial时的MRS设定
  • 绝大部分的AC timing参数都通过script从catalog中提取出来，然后反过来constraint其它的变量，从catalog提取的参数有：
  
sd_banksra_addrca_addrtcktccd_cnttrtp_cnttwtr_lentmod_len
txsdll_lentrp_lentmrd_lentrc_lentrfc_lentrefitrrd_lentrcd_len
tras_mintras_maxtras_lentfaw_lentwr_lentzqcs_lenmem_speedtdllk
tmprrtwlotwlmrdtxprtzqinittzqcl_lentzqopertckesr
tcksretcksrx

DDR2 Constraint

MR0

由于synopsys DDR2 VIP v2016.06好像还有些问题，write_recovery以及cas_latency不是按jedec spec全随机。


                               
登录/注册后可看大图


                               
登录/注册后可看大图


MR1


                               
登录/注册后可看大图


DDR3 constraint

MR0


                               
登录/注册后可看大图


                               
登录/注册后可看大图



                               
登录/注册后可看大图


MR1


                               
登录/注册后可看大图


MR2


                               
登录/注册后可看大图


Post decoding



                               
登录/注册后可看大图


                               
登录/注册后可看大图


                               
登录/注册后可看大图
initial, 项目

相关帖子

畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
回复

举报

返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

×

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-22 06:41 , Processed in 0.021361 second(s), 10 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表