[求助] Xilinx ISE软件顶层原理图设计的技巧

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pinggougou

发表于 2016-5-2 00:53:24 | 显示全部楼层 |阅读模式

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搜了好长时间，没有发现专门的介绍ISE软件如何灵活的进行原理图设计的细节技能。大家在用的时候，有那些技巧吗？？我遇到一个问题，就是给某一模块连上系统始终CLK，如果想断开的，没有断开指令，只能删除，而要删除的话，就把整个图上的clk连线都删除了，那别的模块都要重新连一下，真是太麻烦啦？？
请问你们是怎么解决的？？你们还有别的什么小技巧吗？

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