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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › 进行LVS验证，出现ERC Results报错
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查看: 4039|回复: 1

[求助] 进行LVS验证，出现ERC Results报错

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luoshun
发表于 2015-11-30 10:11:18 | 显示全部楼层 |阅读模式

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viitek
发表于 2016-2-22 09:06:14 | 显示全部楼层
回复 1# luoshun


    这个问题应该是衬底没有连接低点位，或者是rule上没有将地电位名字加全。
请仔细检查psub的连接。
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