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查看: 1751|回复: 3

[求助] Verilog语言

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zhangxin
发表于 2015-11-27 20:00:13 | 显示全部楼层 |阅读模式

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Verilog语言中能否实现RAM一端写入，八端读出？读出的这八端需要有独立的地址线、使能线、数据线
ram, verilog

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南宫恨
发表于 2015-11-28 09:41:21 | 显示全部楼层
可以啊，自己在ram读出端做一个mux就好了
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ryan6253
发表于 2015-11-28 16:47:25 | 显示全部楼层
good job
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zw84611
发表于 2015-11-28 16:59:07 | 显示全部楼层
语言当然可以实现，但没见过这样的RAM IP
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