std cell library 的lvs过不了

dennisi123 · 发表于 2015-8-18 21:20:17

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大家好！最近在用calibre做一个数字模块的lvs，怎么做都过不了。无奈之下直接把数字标准单元的版图做lvs，发现这个标准单元的lvs就过不了。对于一个inv0d7的反相器，它的版图是这样的：[img]file:///D:\program files\Tencent\QQ\QQ2015\1193822692\Image\C2C\W4B$UDZZ3O[S_5~1X3GKLMD.png[/img] QQ图片20150818211914.png

在用calibre做lvs的时候从版图提取的网表：

从原理图提出的网表为：

。我看了下这两个网表管子的尺寸，从版图提出的网表虽然是六个Nmos管子并联，但其宽度加起来还是和原理图提出网表的Nmos一样的。其实这两个是等价的，但是工具会报错：

icfbicfb · 发表于 2015-8-19 08:30:29

没有tapcell 吧，要加tap才能过的，drc也过不了的

dennisi123 · 发表于 2015-8-19 09:09:58

回复 2# icfbicfb

版主你好！求教tapcell怎么加？

我心飞翔618 · 发表于 2015-8-19 09:42:37

加上阱、衬底接触单元才可以过lvs

icfbicfb · 发表于 2015-8-19 09:42:57

addWelltap ,

像是0.18 工艺？

dennisi123 · 发表于 2015-8-19 09:45:35

回复 4# 我心飞翔618

你好！我看了下版图，以一个反相器为例，它的P衬底和N阱都是直接连到VSS和VDD的pin上的，还用加tap cell吗？

Alicezw · 发表于 2015-8-19 10:29:11

检查一下是不是lvs rule文件的问题。

刀演秦义 · 发表于 2015-8-19 11:02:40

回复 7# Alicezw

你好这个和什么设置有关系

dennisi123 · 发表于 2015-8-19 12:09:03

这个是我的设置，我也不知道哪里出问题了

icfbicfb · 发表于 2015-8-19 13:10:04

把cdl 贴出来看看

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