求助怎样用vcs和verdi联合仿真看中间变量

vin3ent · 发表于 2015-7-29 14:16:46

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用Verilog写了一个testbench，想用Verdi看波形，现在顶层文件是testbench，底层文件是原有module，但是有个问题是用vcs编译testbench之后只能观察IO口波形，看不了原来module中间变量的波形，请问怎样才能看中间变量波形，或者monitor出来也行，要改代码怎么去改？

hanxinhui · 发表于 2015-7-29 20:54:30

testbench中的命令 $fsdbDumpvars（）；好像就是决定verdi中显示信号的数量，你可以具体看看这个命令的用法。

vin3ent · 发表于 2015-7-30 09:17:44

回复 2# hanxinhui

不知道为什么我用$fsdbDumpvars()出来的fsdb没有信号，我是用$dumpvars()产生vcd然后verdi自动转换的，但是我看这个命令的用法是前面的数字表示层次数，用0就行，后面跟module名称，但是我module名称如果用原有module的话在vcd里面就没有信号，用testbench就只能显示IO

vin3ent · 发表于 2015-7-30 12:01:51

自己顶一下。。。。

hanxinhui · 发表于 2015-7-30 17:29:19

回复 3# vin3ent

层数0 ，后面跟你module的名字，就是表示你要看的信号是顶层信号。
你试试把0该成别的数字，后面跟一个子模块名字。我也没有这样看过信号，不过这也是一个思路，你可以试试~~

vin3ent · 发表于 2015-7-30 21:46:39

回复 5# hanxinhui

好的非常感谢

zhangjunxf · 发表于 2017-1-7 15:59:28

顶一下。。。。

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