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[招聘] [NVIDIA社招]-Physical Design Methodology Engineer-Shanghai

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发表于 2015-3-14 20:16:11 | 显示全部楼层 |阅读模式

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NVIDIA 视觉计算公司
在二十年的时间里,NVIDIA 一直在视觉计算方面 (计算机图形的艺术与科学) 勇当先锋。
凭借我们发明的 GPU ——现代视觉计算的引擎,这一领域现已扩张到涵盖了视频游戏、电影制作、产品设计、医学诊断以及科学研究等等。
现在,视觉计算正变得越来越重要,它影响着人们与科技之间的互动方式。

NVIDIA坚信我们的领先地位是来自於优秀员工的贡献,毋庸置疑,我们将以最佳方式发掘杰出的人才。

请将个人简历或者联系方式寄至

Mail:         tracyw@nvidia.com             QQ: 1751315121

收到简历之后,我将同您联系。

要求:
- 后端或者EDA PV/AE/AC/RD经验2年以上
- 熟悉后端流程,理解制造工艺
- 对写脚本编程感兴趣,有较多的Tcl/Perl编程经验
职责:
- 负责基于ICC/Talus的后端流程的开发
- 提升流程自动化程度
- 为项目提供支持
- 评估EDA工具

JD----SR. PHYSICAL DESIGN METHODOLOGY ENGINEER
RESPONSIBILITIES
Responsible for the development of the physical design methodologies and flow automation for large and high speed semicustom chips using deep submicron processes.
This includes evaluating and helping improve third party tools, developing internal tools and solutions, and supporting the physical design implementation team.
MINIMUM REQUIREMENTS:
    BSEE or BSCS, 2+ years of experience in large VLSI physical design implementation and automation and methodology.
    Strong experience in programming of one of the following area: C/C++, Perl, Python.
    Prior experience in timing closure, CTS, power distribution and analysis, power efficiency, RC extraction and correlation, xtalk analysis, signal EM, place and route, DRC/LVS and tapeout issues.  
    Work knowledge of deep sub-micronissues.  
    Should be a power user of P&R and timing analysis CAD tools from Magma (Blast, Talus), Synopsys (ICC/DC/PT/STAR-RC/Astro/PC), Cadence (SOCE), Mentor Graphics (Pinnacle/Olympus) or Atoptech.
    Proficiency using Perl, TCL, Makescripting.  
    Knowledge/Proficiency of C/C++ or any other software language is a plus.
    Circuit level comprehension of time critical paths and Spice experience are a plus.

Best Regards

Tracy
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