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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › verilog 练习题，很不错，能独立做完，可以胜任一般项目 ...
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楼主: newlook

verilog 练习题，很不错，能独立做完，可以胜任一般项目了

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发表于 2008-4-2 22:15:41 | 显示全部楼层
我也正在学习中谢谢
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发表于 2009-10-15 15:16:37 | 显示全部楼层
这个很好，谢谢楼主
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walle2
发表于 2009-10-15 15:25:44 | 显示全部楼层
谢谢十分需要
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发表于 2009-10-15 16:24:55 | 显示全部楼层
谢啦，今晚就要上Verilog的第一堂课了……
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发表于 2009-10-16 12:53:45 | 显示全部楼层
发个帖 看看
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kanke100
发表于 2009-10-16 13:23:50 | 显示全部楼层
很好，谢谢！
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发表于 2009-10-16 13:30:57 | 显示全部楼层
只是一般的练习吗？
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发表于 2009-10-16 17:10:13 | 显示全部楼层
有答案吗？
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发表于 2009-10-16 17:54:18 | 显示全部楼层
有答案的不？？
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发表于 2009-10-16 18:04:33 | 显示全部楼层
10# risccpu 是啊。是某本书上的
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