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楼主: 幸福在哪里

[求助] 关于PLL总体相位噪声的水平

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 楼主| 发表于 2014-12-30 10:25:39 | 显示全部楼层
回复 6# 幸福在哪里

还真的是,VCO的噪声是高通特性吧?那应该就是我搞错了 我去看看我的传输函数。谢谢啊。
 楼主| 发表于 2014-12-30 10:30:50 | 显示全部楼层
回复 10# lwjee


   只考虑了VCO、CP、PFD、LPF、以及一部分的输入参考噪声   没有考虑电源噪声和分频器的噪声
   所以噪声可能偏低
   输入时钟10M 输出160M  带宽1M 还是比较low的参数==
发表于 2016-7-20 10:39:31 | 显示全部楼层
回复 7# fuyibin


   你好!你是怎么用cadence仿真PLL噪声的,如果可以给我一些资料看看,感谢了啊!!!
发表于 2016-12-25 18:35:18 | 显示全部楼层
回复 13# sekong179

给你个网址,自己去看
http://www.ece.utah.edu/~ccharles/ee536/
发表于 2016-12-29 10:52:42 | 显示全部楼层
回复 7# fuyibin


   请问实测的时候input reference 以及power/IO引入的Noise带来的影响大吗?仿真的时候怎么模拟?
发表于 2017-6-22 10:17:12 | 显示全部楼层
你好,我是一个matlab小白,请问一下看输出相位噪声,软件中有自带的模块,还是需要自己写程序呢?谢谢
发表于 2023-4-28 23:31:18 | 显示全部楼层
学习了
发表于 2023-7-1 14:32:46 | 显示全部楼层


幸福在哪里 发表于 2014-12-29 11:51
回复 5# fuyibin

楼上的意思是PFD+CP对于总噪声的贡献在高频处不应该有突起。  但是我仿的时候是PFD+CP+L ...


您好,我有一个问题想问一下,如果将PFD+CP+LPF一起仿真,得到的噪声功率谱如何最后得到总噪声,LPF的噪声传递函数和前二者是不同的;


                               
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其次,我在其他帖子上看到有人将unit先统一到dB,那最后应该如何转换成dBc/Hz,谢谢您(本人刚接触PLL不久,还请不吝赐教)
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