PMOS栅压17V,S、B端电压5V,有没有问题？

istart_2002 · 发表于 2014-12-22 01:11:18

本帖最后由 istart_2002 于 2014-12-26 00:58 编辑

PMOS栅压17V,S、B端电压5V的时候有没有问题？
QQ截圖20141211130820.jpg

GodofSun · 发表于 2014-12-22 01:11:19

回复 3# istart_2002

可以用，没有问题。

GodofSun · 发表于 2014-12-22 08:17:54

至少交代一下器件类型吧。。。

istart_2002 · 发表于 2014-12-24 08:30:29

至少交代一下器件类型吧。。。
GodofSun 发表于 2014-12-22 08:17

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对称型高压管 vgs vds都耐压24伏

andy2000a · 发表于 2014-12-24 08:35:07

回复 1# istart_2002

你 pmos source =vdd , bulk=source ,
為何說 s-b 5v ?

drain電壓不知

istart_2002 · 发表于 2014-12-24 09:33:06

回复  istart_2002

你 pmos  source =vdd , bulk=source ,
為何說 s-b  5v ?

drain電壓不知
andy2000a 发表于 2014-12-24 08:35

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S,B端都是5V,不是差5V; d端开始为0,后来被拉高到5V

andy2000a · 发表于 2014-12-25 08:32:15

回复 5# istart_2002

所以你是 pmos  drain => 接地使用
pmos gate=17v ,  pmos s/b =vddl =5v ?

那表示 pmos gs= 12v壓差.  pmos gate耐高壓嗎?

semico_ljj · 发表于 2014-12-25 13:25:28

istart_2002 · 发表于 2014-12-25 16:56:13

回复  istart_2002

所以你是 pmos  drain => 接地使用
pmos gate=17v ,  pmos s/b =vddl =5v ?

...
andy2000a 发表于 2014-12-25 08:32

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vgs耐压24伏

istart_2002 · 发表于 2014-12-26 15:44:40

回复 istart_2002

可以用，没有问题。
GodofSun 发表于 2014-12-25 17:17

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因为vsg为-12V，p型SD之间不会形成导电沟道？

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