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[求助] VCO电源噪声抑制

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发表于 2014-11-10 19:14:21 | 显示全部楼层 |阅读模式

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经常看到很多论文上面都描述电源噪声对VCO相位噪声的影响,但一直都没弄明白,电源噪声是怎么影响VCO的频率抖动的,就拿一个我最近在做的VCO电路图来说, 4_2`2)530O9%@XOLQ7F$_LA.jpg 这个电路图,电源噪声是怎么对VCO造成影响的?是由于电容的耦合吗?   还有,是不是电源噪声会对控制电压线有干扰从而造成频率抖动呢??我全都不是很确定,所以来这里求证,顺便还望高人能够补充,减小电源噪声影响的措施有哪些呢?看到论文上说全差分可以减小电源噪声,说什么此时的噪声表现为共模噪声,为什么呢??电源噪声是怎么干扰全差分VCO的?又是怎么不会对全差分VCO造成影响的?
发表于 2014-11-11 15:09:00 | 显示全部楼层
看看这几篇paper
A Study of Oscillator Jitter Due to Supply and Substrate Noise.pdf (218.72 KB, 下载次数: 350 )
A Study of Phase Noise in CMOS Oscillators.pdf (332.59 KB, 下载次数: 271 )
Noise in Phase-Locked Loops - Hajimiri.pdf (582.93 KB, 下载次数: 239 )
 楼主| 发表于 2014-11-12 03:21:22 | 显示全部楼层
回复 2# jamesccp

   好东西,谢谢
发表于 2014-11-12 10:45:03 | 显示全部楼层
回复 1# 何平

     直观上就是电源大小变化时,那个inverter一级级的反转点有变化了,所以频率一直随这个电源电压波动吧。
发表于 2021-3-2 05:28:07 | 显示全部楼层
多谢分享
发表于 2021-3-2 08:08:42 | 显示全部楼层
感谢感谢
发表于 2021-5-18 15:18:48 | 显示全部楼层
感谢分享
发表于 2021-6-16 22:09:43 | 显示全部楼层
感谢分享
发表于 2021-8-18 17:14:21 | 显示全部楼层
谢谢分享
发表于 2021-8-19 10:38:21 | 显示全部楼层
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