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[求助] 初次接触DC,时序报告,违例

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发表于 2014-10-17 12:11:39 | 显示全部楼层 |阅读模式

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Information: Propagating switching activity (low effort zero delay simulation). (PWR-6)
Warning: Design has unannotated primary inputs. (PWR-414)
Warning: Design has unannotated sequential cell outputs. (PWR-415)
****************************************
Report : constraint
        -all_violators
Design : aes_ASIC
Version: C-2009.06-SP5
Date   : Wed Oct 15 23:21:06 2014
****************************************


   min_delay/hold ('wb_clk' group)

                             Required        Actual
   Endpoint                 Path Delay     Path Delay        Slack
   -----------------------------------------------------------------
   PAD_wb_ack_o                 2.10           1.43 f        -0.67  (VIOLATED)
   PAD_wb_dat_o[0]              2.10           1.44 f        -0.66  (VIOLATED)
   PAD_wb_dat_o[1]              2.10           1.44 f        -0.66  (VIOLATED)
   PAD_wb_dat_o[2]              2.10           1.44 f        -0.66  (VIOLATED)
   PAD_wb_dat_o[3]              2.10           1.44 f        -0.66  (VIOLATED)
   PAD_wb_dat_o[4]              2.10           1.44 f        -0.66  (VIOLATED)
   PAD_wb_dat_o[5]              2.10           1.44 f        -0.66  (VIOLATED)
   PAD_wb_dat_o[6]              2.10           1.44 f        -0.66  (VIOLATED)
   PAD_wb_dat_o[7]              2.10           1.44 f        -0.66  (VIOLATED)
这是其中一部分,大神们帮忙看看,1.43f  啥意思?另外哪里有时序报告教程?
 楼主| 发表于 2014-10-17 12:26:02 | 显示全部楼层
顶一顶
发表于 2014-10-17 12:49:03 | 显示全部楼层
帮顶!!!!
发表于 2014-10-17 14:21:20 | 显示全部楼层
fall,剩下还有rise,STA基础,论坛资料区里有很多
发表于 2014-11-10 13:25:44 | 显示全部楼层
感觉要学的好多啊。。。。
发表于 2014-12-31 11:14:03 | 显示全部楼层
Hold  violator综合的时候可以不用管,等到后端插Buffer来解决~
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