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楼主: ICSYS

[求助] v2lvs转spice网表时的问题【已解决】

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发表于 2020-3-27 18:26:22 | 显示全部楼层


   
1027199631 发表于 2017-12-1 20:54
回复 3# zero_0

使用v2lvs -i转换的.cdl与原先的门级网表连接关系不一致了(lib.v的端口顺序与lib.cdl中 ...


也想知道怎样解决这问题
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发表于 2020-10-29 06:22:55 | 显示全部楼层


   
duffrose 发表于 2020-3-27 18:26
也想知道怎样解决这问题


请问这个问题解决了吗?怎么做的?
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发表于 2020-11-2 11:30:27 | 显示全部楼层


   
1027199631 发表于 2017-12-1 20:54
回复 3# zero_0

使用v2lvs -i转换的.cdl与原先的门级网表连接关系不一致了(lib.v的端口顺序与lib.cdl中 ...


请问这个问题你解决了吗?
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发表于 2021-4-25 15:48:33 | 显示全部楼层
我试了一下,只能用v2s,不能用v2lvs,即使v2lvs用了pin order的option。
因为verilog是区别大小写的,而spice不区分,v2lvs导出的spice网表不能把同名(大小写不同)的verilog net正确实别。
而v2s可以自动给同名的net重命名。
v2s需要用-s option给出底层subckt的库,比入std cell,来保证pin的顺序一致。
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发表于 2025-7-22 13:55:48 | 显示全部楼层


   
suyer 发表于 2021-4-25 15:48
我试了一下,只能用v2s,不能用v2lvs,即使v2lvs用了pin order的option。
因为verilog是区别大小写的,而sp ...


请问v2s是哪个工具下面的,目前我们的环境里没有这个小工具
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发表于 2025-7-22 14:19:07 | 显示全部楼层


   
圆滚滚 发表于 2025-7-22 13:55
请问v2s是哪个工具下面的,目前我们的环境里没有这个小工具


Calibre吧
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发表于 2025-7-22 15:33:26 | 显示全部楼层


谢谢,我在synopsys的hsim下找到了这个组件
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