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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 求助,谁有乘法器和除法器完善的从理论到Verilog HDL语言 ...
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楼主: xvminjun

求助,谁有乘法器和除法器完善的从理论到Verilog HDL语言实现的资料啊

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发表于 2009-7-15 13:17:47 | 显示全部楼层
ok ,thansk
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发表于 2009-7-15 20:27:36 | 显示全部楼层
xiexie!
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hui3462
发表于 2009-7-15 22:52:36 | 显示全部楼层
估计不好弄
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alyssa
发表于 2009-8-25 19:27:59 | 显示全部楼层
先回帖，再下载
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Xhero
发表于 2009-9-8 15:50:47 | 显示全部楼层
谢谢啊，还是好人多
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发表于 2009-9-10 22:17:58 | 显示全部楼层
这个论坛做的真挺好的，大家挺热情哈
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发表于 2009-9-11 15:40:46 | 显示全部楼层
看看   
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发表于 2009-9-12 01:57:03 | 显示全部楼层
顶   顶顶顶
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bigjaw
发表于 2009-9-12 04:50:33 | 显示全部楼层
good
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hudie75
发表于 2009-9-12 12:54:14 | 显示全部楼层
老实说，这是我校，美国，的研究生一门课程的project.
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