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[求助] (已解决)原理没有错,但保存电路原理图时出现shorted output 的警告怎么处理?

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发表于 2013-9-16 06:49:03 | 显示全部楼层 |阅读模式

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本帖最后由 z20102760 于 2013-9-17 12:41 编辑

问题如下图,这是mux2的电路原理图,保存的时候两个tg的输出端出现警告。

2013-09-16_064422.jpg



2013-09-16_064447.jpg
问题原因: 两个tg 的输入端A、输出端Y的引脚属性设置错误

解决办法:将tg 的 A和Y 引脚均设置为inputOutput ,因为tg 是可以双向导通的。之前错误的设置是:A(input),Y(output)
发表于 2013-9-16 11:34:10 | 显示全部楼层
应该可以忽略吧
发表于 2013-9-16 20:24:16 | 显示全部楼层
这种连接方式默认是报warning的,如果确认没有问题可以忽略,不影响仿真和LVS。
发表于 2013-9-17 09:19:17 | 显示全部楼层
看同事做忽略
发表于 2013-9-17 09:33:29 | 显示全部楼层
清掉後 再重新拉線 試試
发表于 2013-9-17 13:18:52 | 显示全部楼层
两个cell都是output pin, 你接到一起,当然会报 short warning,
提示信息写的很清楚, 要避免这个问题,需要把pin改成in 或inout
 楼主| 发表于 2013-9-17 14:26:11 | 显示全部楼层
回复 6# fuyibin


   感谢,我已经发现这个问题了。
发表于 2015-12-3 09:22:53 | 显示全部楼层
哈哈哈哈
发表于 2016-3-8 14:36:05 | 显示全部楼层
碰到同样的问题,多谢~
发表于 2016-3-9 08:53:34 | 显示全部楼层
只是端口定义问题,把传输门的output改inout就没事了,尽量把这样的warning给去掉。
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