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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog验证 测试平台编写指南.zip
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楼主: wind_vip

[资料] SystemVerilog验证 测试平台编写指南.zip

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ting314
发表于 2018-1-26 04:42:31 | 显示全部楼层
回复 1# wind_vip


   thanks
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leijing
发表于 2018-2-13 15:07:14 | 显示全部楼层
下载下来看看
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ens
发表于 2018-2-22 09:59:04 | 显示全部楼层
Thanks for sharing!!!!
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lovemyhikaru
发表于 2018-2-22 14:37:10 | 显示全部楼层
谢谢楼主分享 下载下来看看
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janezhan
发表于 2018-2-26 10:15:00 | 显示全部楼层
回复 1# wind_vip
谢谢
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yqynier
发表于 2018-2-26 21:51:39 | 显示全部楼层
谢谢楼主
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wykbest
发表于 2018-2-28 21:03:02 | 显示全部楼层
资料不错谢谢很好啊
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东方之子yj
发表于 2018-3-12 09:47:33 | 显示全部楼层
扫描版的，不过中文的看起来还是容易很多。
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roomby
发表于 2018-3-12 18:18:32 | 显示全部楼层
资料不错谢谢
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k52377
发表于 2018-4-17 23:12:36 | 显示全部楼层
楼主 神人也 谢谢分享了
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