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下边是我的运放的建立图形,为什么在没有达到最高点(0.6V)的时候,有一个向下的脉冲呢,我的运放如下图2所 ... 相位裕度有68deg,即使相位裕度不足,也应该先有有一个过0.6V的脉冲。renature 发表于 2013-7-24 17:11 登录/注册后可看大图
03_The CMOS gain boosting technique.pdf
2013-9-26 17:46 上传
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