SIWAVE 5.0 在validate后, 显示DC SHORT问题解决

xwhz · 发表于 2013-7-9 01:09:36

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供大家参考:
我从Ansoftlink将Allegro PCB layout导入至SIWAVE 5.0, 在VALIDATE时会显示有很多DC SHORT; 这些SHORT都是信号和地层出现短路.有的时候是在加了PORT准备跑SIMULATION时, CHECK时显示DC SHORT, 研究了很久无法解决软件的安装问题, 但分析原因可能是因为在转换过程中padstack丢失了部分Antipad的信息, 因此在edit padstack补上相关antipad后, 就没有short了. 再跑仿真就可以算出波形了.
希望对大家有所帮助。

fsea · 发表于 2013-7-9 08:49:05

有用，有用。谢谢楼主

mandy517 · 发表于 2013-7-9 16:42:15

可以請問一下樓主您是如何補的嗎?

xwhz · 发表于 2013-7-9 22:10:21

回复 3# mandy517

回3#, 用ALLEGRO已经画好了图, 地早就铺好了; 不需要在SIWAVE上去重新铺地的. 点edit->layer stack可以观看.
如果你没有看到地层, 可能需要在stackup插入新的metal层, 再draw->rectangle, 并assign net为GND. "GND" net要已经存在才可.

乖乖猪猪想熊 · 发表于 2014-1-16 14:09:28

楼主，求助，使用SIWAVE 5.0对protel99se PCB进行电磁兼容分析，要如何将PCB文件成功导入到SIWAVE中，说仔细点步骤吧，我还在论坛上下载了，ANF/ASC文件，用SIWAVE导入不了，求楼主帮忙啊，，联系我，546812238@qq.com

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