设为首页收藏本站

eetop公众号

创芯大讲堂

创芯人才网

切换到宽版

手机号码，快捷登录

创芯云服务 : 创芯大讲堂 | 创芯人才网 | 数字IC职业培训 EETOP诚邀线上IC培训讲师!

搜帖子

EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 基于FPGA的数字秒表的VHDL设计

发新帖

查看: 1310|回复: 2

[资料] 基于FPGA的数字秒表的VHDL设计

发表于 2013-6-22 00:39:18 | 显示全部楼层 |阅读模式

马上注册，结交更多好友，享用更多功能，让你轻松玩转社区。

您需要登录才可以下载或查看，没有账号？注册

x

基于FPGA 的数字秒表的VHDL 设计

95.33 KB, 下载次数: 22 , 下载积分: 资产 -2 信元, 下载支出 2 信元

回复

发表于 2014-4-18 12:09:51 | 显示全部楼层

111111111111

EETOP创芯人才网职位发布入口

回复支持反对

发表于 2014-5-2 01:23:49 | 显示全部楼层

学习学习

回复支持反对

发新帖

高级模式

B Color Image Link Quote Code Smilies

您需要登录后才可以回帖登录 | 注册

本版积分规则回帖后跳转到最后一页

关闭

站长推荐 /2

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号京公网安备:11010502037710 )

GMT+8, 2024-12-23 12:33 , Processed in 0.016954 second(s), 7 queries , Gzip On, Redis On.

eetop公众号

创芯大讲堂

创芯人才网

快速回复 返回顶部 返回列表