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[求助] 用VCS进行仿真带Altera DDR3 core的DUV时,不知道要加哪些文件?

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发表于 2013-5-15 19:44:53 | 显示全部楼层 |阅读模式

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用VCS进行仿真带Altera DDR3 core的DUV时,不知道要加哪些文件?
a,我先是通过生成 ddr3 core时自带的ddr3_core_sim文件夹E\ddr3_core_sim\synopsys\vcs\vcs_setup.sh中的库文件和.sv以及.v文件加到filelist中,结果报错如下:ddr3_core_p0_simple_ddio_out.sv,197
              Elaboration time unknown or bad value encountered for generate for-statement condition expression.
              Please make sure it is elabaration time constant.
  b,后来则是将ddr3_core文件夹中的全部.v和.sv都包含进去,结果的错误更多。我已经加了一些常用的库文件。不知道用vcs仿真时,怎么确认要加的core文件??
以下是我添加的一些库文件:
/tools/altera/quartus12.1_177/quartus/eda/sim_lib/altera_primitives.v                                                                                       
/tools/altera/quartus12.1_177/quartus/eda/sim_lib/220model.v                                                                                                
/tools/altera/quartus12.1_177/quartus/eda/sim_lib/sgate.v                                                                                                   
/tools/altera/quartus12.1_177/quartus/eda/sim_lib/altera_mf.v                                                                                                
/tools/altera/quartus12.1_177/quartus/eda/sim_lib/altera_lnsim.sv                                                                                            
/tools/altera/quartus12.1_177/quartus/eda/sim_lib/synopsys/arriav_atoms_ncrypt.v                                                                           
/tools/altera/quartus12.1_177/quartus/eda/sim_lib/synopsys/arriav_hmi_atoms_ncrypt.v                                                                        
/tools/altera/quartus12.1_177/quartus/eda/sim_lib/arriav_atoms.v                                                                                      
/tools/altera/quartus12.1_177/quartus/eda/sim_lib/synopsys/arriav_hssi_atoms_ncrypt.v                                                                    
/tools/altera/quartus12.1_177/quartus/eda/sim_lib/arriav_hssi_atoms.v
发表于 2013-8-2 19:04:56 | 显示全部楼层
这个需要看看read me文件,里面有教操作的
发表于 2015-12-25 11:50:26 | 显示全部楼层
用qsys
连上clk rst cfg phy
生成一个example后就能从 tcl脚本参考filelist
发表于 2015-12-26 22:32:33 | 显示全部楼层
There is one *.qip file at each IP core folder with Altera IP. When you simulated IP, you can refer the matched .shell file.
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