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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › SOC设计论坛 › SOC讨论区 › some Synopsys SNUG paper about DDR2/DDR3
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[资料] some Synopsys SNUG paper about DDR2/DDR3

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jgao2000
发表于 2012-12-24 13:12:41 | 显示全部楼层 |阅读模式

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WB3.3_paper_dhanpathy.rar (1.11 MB, 下载次数: 91 ) Simulation Success with HSIM in DDR DRAM Design.rar (190.66 KB, 下载次数: 75 ) DDR2-533 and Beyond with DesignWare甅emory Interface IP.rar (310.34 KB, 下载次数: 92 ) Constructing Timing Budgets and Improving Timing Margins for DDRn Memory Interfaces.rar (1.15 MB, 下载次数: 122 ) A Unique Approach to High Speed Read FIFO Timing Closure In DDR2_3 Sub-system.rar (531.96 KB, 下载次数: 82 ) High_Speed_Design_Challenges_in_DDR3_2_SDRAM.rar (5.49 MB, 下载次数: 159 ) Working with DDRs in PrimeTime.rar (131.54 KB, 下载次数: 76 ) System level STA methodology with DDR.rar (78.32 KB, 下载次数: 85 ) now studing DDR2/3, those papers seesm good, share it
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jgao2000
 楼主| 发表于 2013-1-19 17:19:57 | 显示全部楼层
ding by my self
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chhwang0123
发表于 2013-3-8 01:15:42 | 显示全部楼层
Thank you
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ggouhwpb
发表于 2013-9-29 10:10:14 | 显示全部楼层
haoxiangbudeuocude
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ggouhwpb
发表于 2013-9-29 10:11:21 | 显示全部楼层
qianbugoulemahde
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ggouhwpb
发表于 2013-9-29 10:12:38 | 显示全部楼层
zailaiyicidheya
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tpungi
发表于 2018-9-29 21:22:19 | 显示全部楼层
Thanks for sharing
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yesterdaymore
发表于 2018-10-8 16:57:26 | 显示全部楼层
下来看看
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virsim
发表于 2018-11-5 12:31:54 | 显示全部楼层
多谢分享
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shsoc
发表于 2018-11-8 18:17:15 | 显示全部楼层
goodd
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